什么是瓷片电容

1 布局的设计
Protel 虽然具有自动布局的功能,但并不能完全满足高频电路的工作需要,往往要凭借设计者的经验,根据具体情况,先采用手工布局的方法优化调整部分元器件的位置,再结合自动布局完成PCB的整体设计。布局的合理与否直接影响到产品的寿命、稳定性、EMC (电磁兼容)等,必须从电路板的整体布局、布线的可通性和PCB的可制造性、机械结构、散热、EMI(电磁干扰) 、可靠性、信号的完整性等方面综合考虑。
一般先放置与机械尺寸有关的固定位置的元器件,再放置特殊的和较大的元器件,最后放置小元器件。同时,要兼顾布线方面的要求,高频元器件的放置要尽量紧凑,信号线的布线才能尽可能短,从而降低信号线的交叉干扰等。
11 与机械尺寸有关的定位插件的放置
电源插座、开关、PCB之间的接口、指示灯等都是与机械尺寸有关的定位插件。通常,电源与PCB之间的接口放到PCB的边缘处,并与PCB 边缘要有3 mm～5 mm的间距;指示发光二极管应根据需要准确地放置;开关和一些微调元器件,如可调电感、可调电阻等应放置在靠近PCB 边缘的位置,以便于调整和连接;需要经常更换的元器件必须放置在器件比较少的位置,以易于更换。
12 特殊元器件的放置
大功率管、变压器、整流管等发热器件,在高频状态下工作时产生的热量较多,所以在布局时应充分考虑通风和散热,将这类元器件放置在PCB上空气容易流通的地方。大功率整流管和调整管等应装有散热器,并要远离变压器。电解电容器之类怕热的元件也应远离发热器件,否则电解液会被烤干,造成其电阻增大,性能变差,影响电路的稳定性。
易发生故障的元器件,如调整管、电解电容器、继电器等,在放置时还要考虑到维修方便。对经常需要测量的测试点,在布置元器件时应注意保证测试棒能够方便地接触。
由于电源设备内部会产生50 Hz泄漏磁场,当它与低频放大器的某些部分交连时,会对低频放大器产生干扰。因此,必须将它们隔离开或者进行屏蔽处理。放大器各级最好能按原理图排成直线形式,如此排法的优点是各级的接地电流就在本级闭合流动,不影响其他电路的工作。输入级与输出级应当尽可能地远离,减小它们之间的寄生耦合干扰。
考虑各个单元功能电路之间的信号传递关系,还应将低频电路和高频电路分开,模拟电路和数字电路分开。集成电路应放置在PCB的中央,这样方便各引脚与其他器件的布线连接。
电感器、变压器等器件具有磁耦合,彼此之间应采用正交放置,以减小磁耦合。另外,它们都有较强的磁场,在其周围应有适当大的空间或进行磁屏蔽,以减小对其他电路的影响。
在PCB的关键部位要配置适当的高频退耦电容,如在PCB电源的输入端应接一个10μF～100 μF的电解电容,在集成电路的电源引脚附近都应接一个001 pF左右的瓷片电容。有些电路还要配置适当的高频或低频扼流圈,以减小高低频电路之间的影响。这一点在原理图设计和绘制时就应给予考虑,否则也将会影响电路的工作性能。
元器件排列时的间距要适当,其间距应考虑到它们之间有无可能被击穿或打火。
含推挽电路、桥式电路的放大器,布置时应注意元器件电参数的对称性和结构的对称性,使对称元器件的分布参数尽可能一致。
在对主要元器件完成手动布局后,应采用元器件锁定的方法,使这些元器件不会在自动布局时移动。即执行Edit change命令或在元器件的Properties选中Locked就可以将其锁定不再移动。
13 普通元器件的放置
对于普通的元器件,如电阻、电容等,应从元器件的排列整齐、占用空间大小、布线的可通性和焊接的方便性等几个方面考虑,可采用自动布局的方式。
2 布线的设计
布线是在合理布局的基础上实现高频PCB 设计的总体要求。布线包括自动布线和手动布线两种方式。通常,无论关键信号线的数量有多少,首先对这些信号线进行手动布线,布线完成后对这些信号线布线进行仔细检查,检查通过后将其固定,再对其他布线进行自动布线。即采用手动和自动布线相结合来完成PCB的布线。
在高频PCB的布线过程中应特别注意以下几个方面问题。
21 布线的走向
电路的布线最好按照信号的流向采用全直线,需要转折时可用45°折线或圆弧曲线来完成,这样可以减少高频信号对外的发射和相互间的耦合。高频信号线的布线应尽可能短。要根据电路的工作频率,合理地选择信号线布线的长度,这样可以减少分布参数,降低信号的损耗。制作双面板时,在相邻的两个层面上布线最好相互垂直、斜交或弯曲相交。避免相互平行,这样可以减少相互干扰和寄生耦合。
高频信号线与低频信号线要尽可能分开,必要时采取屏蔽措施,防止相互间干扰。对于接收比较弱的信号输入端,容易受到外界信号的干扰,可以利用地线做屏蔽将其包围起来或做好高频接插件的屏蔽。同一层面上应该避免平行走线,否则会引入分布参数,对电路产生影响。若无法避免时可在两平行线之间引入一条接地的铜箔,构成隔离线。
在数字电路中,对于差分信号线,应成对地走线,尽量使它们平行、靠近一些,并且长短相差不大。
22 布线的形式
在PCB的布线过程中,走线的最小宽度由导线与绝缘层基板之间的粘附强度以及流过导线的电流强度所决定。当铜箔的厚度为005mm、宽度为1mm ～15 mm时,可以通过2A电流。温度不会高于3 ℃,除一些比较特殊的走线外,同一层面上的其他布线宽度应尽可能一致。在高频电路中布线的间距将影响分布电容和电感的大小,从而影响信号的损耗、电路的稳定性以及引起信号的干扰等。在高速开关电路中,导线的间距将影响信号的传输时间及波形的质量。因此,布线的最小间距应大于或等于05 mm,只要允许,PCB布线最好采用比较宽的线。
印制导线与PCB的边缘应留有一定的距离(不小于板厚) ,这样不仅便于安装和进行机械加工,而且还提高了绝缘性能。
布线中遇到只有绕大圈才能连接的线路时,要利用飞线,即直接用短线连接来减少长距离走线带来的干扰。
含有磁敏元件的电路其对周围磁场比较敏感,而高频电路工作时布线的拐弯处容易辐射电磁波,如果PCB中放置了磁敏元件,则应保证布线拐角与其有一定的距离。
同一层面上的布线不允许有交叉。对于可能交叉的线条,可用“钻”与“绕”的办法解决,即让某引线从其他的电阻、电容、三极管等器件引脚下的空隙处“钻”过去,或从可能交叉的某条引线的一端“绕”过去。在特殊情况下,如果电路很复杂,为了简化设计,也允许用导线跨接解决交叉问题。
当高频电路工作频率较高时,还需要考虑布线的阻抗匹配及天线效应问题。
23 电源线与地线的布线要求
根据不同工作电流的大小,尽量加大电源线的宽度。高频PCB应尽量采用大面积地线并布局在PCB的边缘,可以减少外界信号对电路的干扰;同时,可以使PCB的接地线与壳体很好地接触,使PCB的接地电压更加接近于大地电压。应根据具体情况选择接地方式,与低频电路有所不同,高频电路的接地线应该采用就近接地或多点接地的方式,接地线短而粗,以尽量减少地阻抗,其允许电流要求能够达到3倍于工作电流的标准。扬声器的接地线应接在PCB 功放输出级的接地点,切勿任意接地。
在布线过程中还应该及时地将一些合理的布线锁定,以免多次重复布线。即执行EditselectNet命令在预布线的属性中选中Locked就可以将其锁定不再移动。
3 焊盘及敷铜的设计
31 焊盘与孔径
在保证布线最小间距不违反设计的电气间距的情况下,焊盘的设计应较大,以保证足够的环宽。一般焊盘的内孔要比元器件的引线直径稍微大一点,设计过大,容易在焊接中形成虚焊。焊盘外径D 一般不小于(d+12)mm,其中d为焊盘内孔径,对于一些密度比较大的PCB ,焊盘的最小值可以取(d+10) mm。焊盘的形状通常设置为圆形,但是对于DIP封装的集成电路的焊盘最好采用跑道形,这样可以在有限的空间内增大焊盘的面积,有利于集成电路的焊接。布线与焊盘的连接应平滑过渡,即当布线进入圆焊盘的宽度较圆焊盘的直径小时,应采用补泪滴设计。
需要注意的是,焊盘内孔径d的大小是不同的,应当根据实际元器件引线直径的大小加以考虑,如元件孔、安装孔和槽孔等。而焊盘的孔距也要根据实际元器件的安装方式进行考虑,如电阻、二极管、管状电容器等元件有“立式”、“卧式”两种安装方式,这两种方式的孔距是不同的。此外,焊盘孔距的设计还要考虑元器件之间的最小间隙要求,特别是特殊元器件之间的间隙需要由焊盘间的孔距来保证。
在高频PCB中,还要尽量减少过孔的数量,这样既可减少分布电容,又能增加PCB的机械强度。总之,在高频PCB的设计中,焊盘及其形状、孔径与孔距的设计既要考虑其特殊性,又要满足生产工艺的要求。采用规范化的设计,既可降低产品成本,又可在保证产品质量的同时提高生产的效率。
32 敷铜
敷铜的主要目的是提高电路的抗干扰能力,同时对于PCB散热和PCB的强度有很大好处,敷铜接地又能起到屏蔽的作用。但是不能使用大面积条状铜箔,因为在PCB的使用中时间太长时会产生较大热量,此时条状铜箔容易发生膨胀和脱落现象,因此,在敷铜时最好采用栅格状铜箔,并将此栅格与电路的接地网络连通,这样栅格将会有较好的屏蔽效果,栅格网的尺寸由所要重点屏蔽的干扰频率而定。
在完成布线、焊盘和过孔的设计后,应执行DRC(设计规则检查) 。在检查结果中详细列出了所设计的图与所定义的规则之间的差异,可查出不符合要求的网络。但是,首先应在布线前对DRC进行参数设定才可运行DRC,即执行ToolsDesign Rule Check命令。
4 结束语
高频电路PCB的设计是一个复杂的过程,涉及的因素很多,都可能直接关系到高频电路的工作性能。因此,设计者需要在实际的工作中不断研究和探索,不断积累经验,并结合新的EDA (电子设计自动化)技术才能设计出性能优良的高频电路PCB。

PCB布线原则

1连线精简原则
连线要精简，尽可能短，尽量少拐弯，力求线条简单明了，特别是在高频回路中，当然为了达到阻抗匹配而需要进行特殊延长的线就例外了，例如蛇行走线等。

2安全载流原则
铜线的宽度应以自己所能承载的电流为基础进行设计，铜线的载流能力取决于以下因素：线宽、线厚（铜铂厚度）、允许温升等，下表给出了铜导线的宽度和导线面积以及导电电流的关系（军品标准），可以根据这个基本的关系对导线宽度进行适当的考虑。

3电磁抗干扰原则
电磁抗干扰原则涉及的知识点比较多，例如铜膜线的拐弯处应为圆角或斜角（因为高频时直角或者尖角的拐弯会影响电气性能）双面板两面的导线应互相垂直、斜交或者弯曲走线，尽量避免平行走线，减小寄生耦合等。

一)通常一个电子系统中有各种不同的地线，如数字地、逻辑地、系统地、机壳地等，地线的设计原则如下：
a正确的单点和多点接地
在低频电路中，信号的工作频率小于1MHZ，它的布线和器件间的电感影响较小，而接地电路形成的环流对干扰影响较大，因而应采用一点接地。当信号工作频率大于10MHZ时，如果采用一点接地，其地线的长度不应超过波长的1/20，否则应采用多点接地法。
b数字地与模拟地分开
若线路板上既有逻辑电路又有线性电路，应尽量使它们分开。一般数字电路的抗干扰能力比较强，例如TTL电路的噪声容限为04~06V，CMOS电路的噪声容限为电源电压的03~045倍，而模拟电路只要有很小的噪声就足以使其工作不正常，所以这两类电路应该分开布局布线。
c接地线应尽量加粗
若接地线用很细的线条，则接地电位会随电流的变化而变化，使抗噪性能降低。因此应将地线加粗，使它能通过三倍于印制板上的允许电流。如有可能，接地线应在2~3mm以上。
d接地线构成闭环路
只由数字电路组成的印制板，其接地电路布成环路大多能提高抗噪声能力。因为环形地线可以减小接地电阻，从而减小接地电位差。

二)配置退藕电容
PCB设计的常规做法之一是在印刷板的各个关键部位配置适当的退藕电容，退藕电容的一般配置原则是：
a电源的输入端跨接10~100uf的电解电容器，如果印制电路板的位置允许，采用100uf以上的电解电容器抗干扰效果会更好。
b原则上每个集成电路芯片都应布置一个001uf~`01uf的瓷片电容，如遇印制板空隙不够，可每4~8个芯片布置一个1~10uf的钽电容（最好不用电解电容，电解电容是两层薄膜卷起来的，这种卷起来的结构在高频时表现为电感，最好使用钽电容或聚碳酸酝电容）。
c对于抗噪能力弱、关断时电源变化大的器件，如RAM、ROM存储器件，应在芯片的电源线和地线之间直接接入退藕电容。
d电容引线不能太长，尤其是高频旁路电容不能有引线。

三)过孔设计
在高速PCB设计中，看似简单的过孔也往往会给电路的设计带来很大的负面效应，为了减小过孔的寄生效应带来的不利影响，在设计中可以尽量做到：
a从成本和信号质量两方面来考虑，选择合理尺寸的过孔大小。例如对6-10层的内存模块PCB设计来说，选用10/20mil（钻孔/焊盘）的过孔较好，对于一些高密度的小尺寸的板子，也可以尝试使用8/18Mil的过孔。在目前技术条件下，很难使用更小尺寸的过孔了（当孔的深度超过钻孔直径的6倍时，就无法保证孔壁能均匀镀铜）；对于电源或地线的过孔则可以考虑使用较大尺寸，以减小阻抗。
b使用较薄的PCB板有利于减小过孔的两种寄生参数。
cPCB板上的信号走线尽量不换层，即尽量不要使用不必要的过孔。
d电源和地的管脚要就近打过孔，过孔和管脚之间的引线越短越好。
e在信号换层的过孔附近放置一些接地的过孔，以便为信号提供最近的回路。甚至可以在PCB板上大量放置一些多余的接地过孔。

四)降低噪声与电磁干扰的一些经验
a能用低速芯片就不用高速的，高速芯片用在关键地方。
b可用串一个电阻的方法，降低控制电路上下沿跳变速率。
c尽量为继电器等提供某种形式的阻尼，如RC设置电流阻尼。
d使用满足系统要求的最低频率时钟。
e时钟应尽量靠近到用该时钟的器件，石英晶体振荡器的外壳要接地。
f用地线将时钟区圈起来，时钟线尽量短。
g石英晶体下面以及对噪声敏感的器件下面不要走线。
h时钟、总线、片选信号要远离I/O线和接插件。
i时钟线垂直于I/O线比平行于I/O线干扰小。
JI/O驱动电路尽量靠近PCB板边，让其尽快离开PCB。对进入PCB的信号要加滤波，从高噪声区来的信号也要加滤波，同时用串终端电阻的办法，减小信号反射。
kMCU无用端要接高，或接地，或定义成输出端，集成电路上该接电源、地的端都要接，不要悬空。
l闲置不用的门电路输入端不要悬空，闲置不用的运放正输入端接地，负输入端接输出端。
m印制板尽量使用45折线而不用90折线布线，以减小高频信号对外的发射与耦合。
n印制板按频率和电流开关特性分区，噪声元件与非噪声元件呀距离再远一些。
o单面板和双面板用单点接电源和单点接地、电源线、地线尽量粗。
p模拟电压输入线、参考电压端要尽量远离数字电路信号线，特别是时钟。
q对A/D类器件，数字部分与模拟部分不要交叉。
r元件引脚尽量短，去藕电容引脚尽量短。
s关键的线要尽量粗，并在两边加上保护地，高速线要短要直。
t对噪声敏感的线不要与大电流，高速开关线并行。
u弱信号电路，低频电路周围不要形成电流环路。
v任何信号都不要形成环路，如不可避免，让环路区尽量小。
w每个集成电路有一个去藕电容。每个电解电容边上都要加一个小的高频旁路电容。
x用大容量的钽电容或聚酷电容而不用电解电容做电路充放电储能电容，使用管状电容时，外壳要接地。
y对干扰十分敏感的信号线要设置包地，可以有效地抑制串扰。
z信号在印刷板上传输，其延迟时间不应大于所有器件的标称延迟时间。

4印制导线最大允许工作电流
公式:I=KT044A075
其中:
K为修正系数，一般覆铜线在内层时取0024，在外层时取0048；
T为最大温升，单位为℃;
A为覆铜线的截面积，单位为mil（不是mm，注意）；
I为允许的最大电流，单位是A。

5环境效应原则
要注意所应用的环境，例如在一个振动或者其他容易使板子变形的环境中采用过细的铜膜导线很容易起皮拉断等。

6安全工作原则
要保证安全工作，例如要保证两线最小间距要承受所加电压峰值，高压线应圆滑，不得有尖锐的倒角，否则容易造成板路击穿等。

7组装方便、规范原则
走线设计要考虑组装是否方便，例如印制板上有大面积地线和电源线区时（面积超过500平方毫米），应局部开窗口以方便腐蚀等。
此外还要考虑组装规范设计，例如元件的焊接点用焊盘来表示，这些焊盘（包括过孔）均会自动不上阻焊油，但是如用填充块当表贴焊盘或用线段当金手指插头，而又不做特别处理，（在阻焊层画出无阻焊油的区域），阻焊油将掩盖这些焊盘和金手指，容易造成误解性错误；SMD器件的引脚与大面积覆铜连接时，要进行热隔离处理，一般是做一个Track到铜箔，以防止受热不均造成的应力集中而导致虚焊；PCB上如果有Φ12或方形12mm以上的过孔时，必须做一个孔盖，以防止焊锡流出等。

8经济原则
遵循该原则要求设计者要对加工，组装的工艺有足够的认识和了解，例如5mil的线做腐蚀要比8mil难，所以价格要高，过孔越小越贵等

9热效应原则
在印制板设计时可考虑用以下几种方法：均匀分布热负载、给零件装散热器，局部或全局强迫风冷。
从有利于散热的角度出发，印制板最好是直立安装，板与板的距离一般不应小于2cm，而且器件在印制板上的排列方式应遵循一定的规则：
同一印制板上的器件应尽可能按其发热量大小及散热程度分区排列，发热量小或耐热性差的器件（如小信号晶体管、小规模集成电路、电解电容等）放在冷却气流的最上（入口处），发热量大或耐热性好的器件（如功率晶体管、大规模集成电路等）放在冷却气流最下。
在水平方向上，大功率器件尽量靠近印刷板的边沿布置，以便缩短传热路径；在垂直方向上，大功率器件尽量靠近印刷板上方布置，以便减少这些器件在工作时对其他器件温度的影响。
对温度比较敏感的器件最好安置在温度最低的区域（如设备的底部），千万不要将它放在发热器件的正上方，多个器件最好是在水平面上交错布局。
设备内印制板的散热主要依靠空气流动，所以在设计时要研究空气流动的路径，合理配置器件或印制电路板。采用合理的器件排列方式，可以有效地降低印制电路的温升。
此外通过降额使用，做等温处理等方法也是热设计中经常使用的手段。

1 一般规则
11 PCB板上预划分数字、模拟、DAA信号布线区域。
12 数字、模拟元器件及相应走线尽量分开并放置於各自的布线区域内。
13 高速数字信号走线尽量短。
14 敏感模拟信号走线尽量短。
15 合理分配电源和地。
16 DGND、AGND、实地分开。
17 电源及临界信号走线使用宽线。
18 数字电路放置於并行总线/串行DTE接口附近，DAA电路放置於电话线接口附近。

2 元器件放置
21 在系统电路原理图中：
a) 划分数字、模拟、DAA电路及其相关电路；
b) 在各个电路中划分数字、模拟、混合数字/模拟元器件；
c) 注意各IC芯片电源和信号引脚的定位。

22 初步划分数字、模拟、DAA电路在PCB板上的布线区域(一般比例2/1/1)，数字、模拟元器件及其相应走线尽量远离并限定在各自的布线区域内。
Note:当DAA电路占较大比重时，会有较多控制/状态信号走线穿越其布线区域，可根据当地规则限定做调整，如元器件间距、高压抑制、电流限制等。

23 初步划分完毕后，从Connector和Jack开始放置元器件：
a) Connector和Jack周围留出插件的位置；
b) 元器件周围留出电源和地走线的空间；
c) Socket周围留出相应插件的位置。

24 首先放置混合型元器件(如Modem器件、A/D、D/A转换芯片等)：
a) 确定元器件放置方向，尽量使数字信号及模拟信号引脚朝向各自布线区域；
b) 将元器件放置在数字和模拟信号布线区域的交界处。

25 放置所有的模拟器件：
a) 放置模拟电路元器件，包括DAA电路；
b) 模拟器件相互靠近且放置在PCB上包含TXA1、TXA2、RIN、VC、VREF信号走线的一面；
c) TXA1、TXA2、RIN、VC、VREF信号走线周围避免放置高噪声元器件；
d) 对於串行DTE模块，DTE EIA/TIA-232-E
系列接口信号的接收/驱动器尽量靠近Connector并远离高频时钟信号走线，以减少/避免每条线上增加的噪声抑制器件，如阻流圈和电容等。

26 放置数字元器件及去耦电容：
a) 数字元器件集中放置以减少走线长度；
b) 在IC的电源/地间放置01uF的去耦电容，连接走线尽量短以减小EMI；
c) 对并行总线模块，元器件紧靠
Connector边缘放置，以符合应用总线接口标准，如ISA总线走线长度限定在25in；
d) 对串行DTE模块，接口电路靠近Connector；
e) 晶振电路尽量靠近其驱动器件。

27 各区域的地线，通常用0 Ohm电阻或bead在一点或多点相连。

3 信号走线
31 Modem信号走线中，易产生噪声的信号线和易受干扰的信号线尽量远离，如无法避免时要用中性信号线隔离。
32 数字信号走线尽量放置在数字信号布线区域内；
模拟信号走线尽量放置在模拟信号布线区域内；
(可预先放置隔离走线加以限定，以防走线布出布线区域)
数字信号走线和模拟信号走线垂直以减小交叉耦合。

33 使用隔离走线(通常为地)将模拟信号走线限定在模拟信号布线区域。
a) 模拟区隔离地走线环绕模拟信号布线区域布在PCB板两面，线宽50-100mil；
b) 数字区隔离地走线环绕数字信号布线区域布在PCB板两面，线宽50-100mil，其中一面PCB板边应布200mil宽度。

34 并行总线接口信号走线线宽>10mil(一般为12-15mil)，如/HCS、/HRD、/HWT、/RESET。

35 模拟信号走线线宽>10mil(一般为12-15mil)，如MICM、MICV、SPKV、VC、VREF、TXA1、TXA2、RXA、TELIN、TELOUT。
36 所有其它信号走线尽量宽，线宽>5mil(一般为 10mil)，元器件间走线尽量短(放置器件时应预先考虑)。

37 旁路电容到相应IC的走线线宽>25mil，并尽量避免使用过孔。

38 通过不同区域的信号线(如典型的低速控制/状态信号)应在一点(首选)或两点通过隔离地线。如果走线只位於一面， 隔离地线可走到PCB的另一面以跳过信号走线而保持连续。

39 高频信号走线避免使用90度角弯转，应使用平滑圆弧或45度角。
310 高频信号走线应减少使用过孔连接。
311 所有信号走线远离晶振电路。

312 对高频信号走线应采用单一连续走线，避免出现从一点延伸出几段走线的情况。
313 DAA电路中，穿孔周围(所有层面)留出至少60mil的空间。
4 电源
41 确定电源连接关系。
42 数字信号布线区域中，用10uF电解电容或钽电容与01uF瓷片电容并联后接在电源/地之间在PCB板电源入口端和最远端各放置一处，以防电源尖峰脉冲引发的噪声干扰。

43 对双面板，在用电电路相同层面中，用两边线宽为 200mil的电源走线环绕该电路。(另一面须用数字地做相同处理)
44 一般地，先布电源走线，再布信号走线。

5 地
51双面板中，数字和模拟元器件(除DAA)周围及下方未使用之区域用数字地或模拟地区域填充，各层面同类地区域连接在一起，不同层面同类地区域通过多个过孔相连:Modem DGND引脚接至数字地区域，AGND引脚接至模拟地区域;数字地区域和模拟地区域用一条直的空隙隔开。

52 四层板中，使用数字和模拟地区域覆盖数字和模拟元器件(除DAA)；Modem DGND引脚接至数字地区域，AGND引脚接至模拟地区域;数字地区域和模拟地区域用一条直的空隙隔开。

53 如设计中须EMI过滤器，应在接口插座端预留一定空间，绝大多数EMI器件(Bead/电容)均可放置在该区域;未使用之区域用地区域填充，如有屏蔽外壳也须与之相连。

54 每个功能模块电源应分开。功能模块可分为：并行总线接口、显示、数字电路(SRAM、EPROM、Modem)和DAA等，每个功能模块的电源/地只能在电源/地的源点相连。
55 对串行DTE模块，使用去耦电容减少电源耦合，对电话线也可做相同处理。

56 地线通过一点相连，如可能，使用Bead；如抑制EMI需要，允许地线在其它地方相连。
57 所有地线走线尽量宽，25-50mil。
58 所有IC电源/地间的电容走线尽量短，并不要使用过孔。

6 晶振电路
61 所有连到晶振输入/输出端(如XTLI、XTLO)的走线尽量短，以减少噪声干扰及分布电容对Crystal的影响。XTLO走线尽量短，且弯转角度不小於45度。(因XTLO连接至上升时间快，大电流之驱动器)
62 双面板中没有地线层，晶振电容地线应使用尽量宽的短线连接至器件上
离晶振最近的DGND引脚，且尽量减少过孔。

63 如可能，晶振外壳接地。
64 在XTLO引脚与晶振/电容节点处接一个100 Ohm电阻。
65 晶振电容的地直接连接至 Modem的GND引脚，不要使用地线区域或地线走线来连接电容和Modem的GND引脚。

7 使用EIA/TIA-232接口的独立Modem设计
71 使用金属外壳。 如果须用塑料外壳，应在内部贴金属箔片或喷导电物质以减小EMI。
72 各电源线上放置相同模式的Choke。
73 元器件放置在一起并紧靠EIA/TIA-232接口的Connector。

74 所有EIA/TIA-232器件从电源源点单独连接电源/地。电源/地的源点应为板上电源输入端或调压芯片的输出端。
75 EIA/TIA-232电缆信号地接至数字地。
76 以下情况EIA/TIA-232电缆屏蔽不用接至Modem外壳;空接;通过Bead接到数字地;EIA/TIA-232电缆靠近Modem外壳处放置一磁环时直接连到数字地。

8 VC及VREF电路电容走线尽量短，且位於中性区域。
81 10uF VC电解电容正极与01uF VC电容的连接端通过独立走线连至Modem的VC引脚(PIN24)。
82 10uF VC电解电容负极与01uF VC电容的连接端通过Bead后用独立走线连至Modem的AGND引脚(PIN34)。

83 10uF VREF电解电容正极与01uF VC电容的连接端通过独立走线连至Modem的VREF引脚(PIN25)。
84 10uF VREF电解电容负极与01uF VC电容的连接端通过独立走线连至Modem的VC引脚(PIN24)；注意与81走线相独立。

VREF ------+--------+
┿ 10u ┿ 01u
VC ------+--------+
┿ 10u ┿ 01u
+--------+-----~~~~~---+ AGND
使用之Bead应满足：
100MHz时，阻抗=70W;;
额定电流=200mA;;
最大电阻=05W。

9 电话和Handset接口
91 Tip和Ring线接口处放置Choke。

92 电话线的去耦方法与电源去耦类似，使用增加电感组合体、Choke、电容等方法。但电话线的去耦比电源去耦更困难也更值得注意， 一般做法是预留这些器件的位置，以便性能/EMI测试认证时调整。

PCB设计的一般原则
内容:印制电路板(PCB)是电子产品中电路元件和器件的支撑件．它提供电路元件和器件之间的电气连接。随着电于技术的飞速发展，PGB的密度越来越高。PCB设计的好坏对抗干扰能力影响很大．因此，在进行PCB设计时．必须遵守PCB设计的一般原则，并应符合抗干扰设计的要求。

PCB设计的一般原则

要使电子电路获得最佳性能，元器件的布且及导线的布设是很重要的。为了设计质量好、造价低的PCB．应遵循以下一般原则：

1布局
首先，要考虑PCB尺寸大小。PCB尺寸过大时，印制线条长，阻抗增加，抗噪声能力下降，成本也增加；过小，则散热不好，且邻近线条易受干扰。在确定PCB尺寸后．再确定特殊元件的位置。最后，根据电路的功能单元，对电路的全部元器件进行布局。

在确定特殊元件的位置时要遵守以下原则：
(1)尽可能缩短高频元器件之间的连线，设法减少它们的分布参数和相互间的电磁干扰。易受干扰的元器件不能相互挨得太近，输入和输出元件应尽量远离。

(2)某些元器件或导线之间可能有较高的电位差，应加大它们之间的距离，以免放电引出意外短路。带高电压的元器件应尽量布置在调试时手不易触及的地方。

(3)重量超过15g的元器件、应当用支架加以固定，然后焊接。那些又大又重、发热量多的元器件，不宜装在印制板上，而应装在整机的机箱底板上，且应考虑散热问题。热敏元件应远离发热元件。

(4)对于电位器、可调电感线圈、可变电容器、微动开关等可调元件的布局应考虑整机的结构要求。若是机内调节，应放在印制板上方便于调节的地方；若是机外调节，其位置要与调节旋钮在机箱面板上的位置相适应。

(5)应留出印制扳定位孔及固定支架所占用的位置。
根据电路的功能单元．对电路的全部元器件进行布局时，要符合以下原则：

(1)按照电路的流程安排各个功能电路单元的位置，使布局便于信号流通，并使信号尽可能保持一致的方向。

(2)以每个功能电路的核心元件为中心，围绕它来进行布局。元器件应均匀、整齐、紧凑地排列在PCB上．尽量减少和缩短各元器件之间的引线和连接。

(3)在高频下工作的电路，要考虑元器件之间的分布参数。一般电路应尽可能使元器件平行排列。这样，不但美观．而且装焊容易．易于批量生产。

(4)位于电路板边缘的元器件，离电路板边缘一般不小于2mm。电路板的最佳形状为矩形。长宽比为3：2成4：3。电路板面尺寸大于200x150mm时．应考虑电路板所受的机械强度。

2．布线
布线的原则如下；
(1)输入输出端用的导线应尽量避免相邻平行。最好加线间地线，以免发生反馈藕合。

(2)印制摄导线的最小宽度主要由导线与绝缘基扳间的粘附强度和流过它们的电流值决定。
当铜箔厚度为005mm、宽度为1~15mm时．通过2A的电流，温度不会高于3℃，因此导线宽度为15mm可满足要求。对于集成电路，尤其是数字电路，通常选002~03mm导线宽度。当然，只要允许，还是尽可能用宽线．尤其是电源线和地线。

导线的最小间距主要由最坏情况下的线间绝缘电阻和击穿电压决定。对于集成电路，尤其是数字电路，只要工艺允许，可使间距小至5~8mm。

(3)印制导线拐弯处一般取圆弧形，而直角或夹角在高频电路中会影响电气性能。此外，尽量避免使用大面积铜箔，否则．长时间受热时，易发生铜箔膨胀和脱落现象。必须用大面积铜箔时，最好用栅格状这样有利于排除铜箔与基板间粘合剂受热产生的挥发性气体。

3焊盘
焊盘中心孔要比器件引线直径稍大一些。焊盘太大易形成虚焊。焊盘外径D一般不小于(d+12)mm，其中d为引线孔径。对高密度的数字电路，焊盘最小直径可取(d+10)mm。

PCB及电路抗干扰措施

印制电路板的抗干扰设计与具体电路有着密切的关系，这里仅就PCB抗干扰设计的几项常用措施做一些说明。

1电源线设计

根据印制线路板电流的大小，尽量加租电源线宽度，减少环路电阻。同时、使电源线、地线的走向和数据传递的方向一致，这样有助于增强抗噪声能力。

2地段设计
地线设计的原则是；

(1)数字地与模拟地分开。若线路板上既有逻辑电路又有线性电路，应使它们尽量分开。低频电路的地应尽量采用单点并联接地，实际布线有困难时可部分串联后再并联接地。高频电路宜采用多点串联接地，地线应短而租，高频元件周围尽量用栅格状大面积地箔。

(2)接地线应尽量加粗。若接地线用很纫的线条，则接地电位随电流的变化而变化，使抗噪性能降低。因此应将接地线加粗，使它能通过三倍于印制板上的允许电流。如有可能，接地线应在2~3mm以上。
(3)接地线构成闭环路。只由数字电路组成的印制板，其接地电路布成团环路大多能提高抗噪声能力。

3退藕电容配置
PCB设计的常规做法之一是在印制板的各个关键部位配置适当的退藕电容。退藕电容的一般配置原则是：

(1)电源输入端跨接10~100uf的电解电容器。如有可能，接100uF以上的更好。

(2)原则上每个集成电路芯片都应布置一个001pF的瓷片电容，如遇印制板空隙不够，可每4~8个芯片布置一个1~10pF的但电容。

(3)对于抗噪能力弱、关断时电源变化大的器件，如RAM、ROM存储器件，应在芯片的电源线和地线之间直接接入退藕电容。

(4)电容引线不能太长，尤其是高频旁路电容不能有引线。此外，还应注意以下两点：

(1在印制板中有接触器、继电器、按钮等元件时．操作它们时均会产生较大火花放电，必须采用附图所示的RC电路来吸收放电电流。一般R取1~2K，C取22~47UF。

(2CMOS的输入阻抗很高，且易受感应，因此在使用时对不用端要接地或接正电源。

经常使用排阻做为上拉或下拉。
排阻的公共端接电源或地线，在实际使用过程中发现，如果排阻值较大则通过公共端耦合引起误动作。
排阻值较小则增加系统功耗。
结论：排阻阻值要慎选，公共端接线或电源线要粗，最好有退耦电容。

可以根据电路板上的电子元件标示符号来认识各个电子元件，而判断电子元件的好坏可以根据仪表的测量结果进行质量评测，仪表的测量误差越小，说明该电子元件的质量越好。

电路板使电路迷你化、直观化，对于固定电路的批量生产和优化用电器布局起重要作用。电路板可称为印刷线路板或印刷电路板，FPC与PCB的诞生与发展，催生了软硬结合板这一新产品。

因此，软硬结合板，就是柔性线路板与硬性线路板，经过压合等工序，按相关工艺要求组合在一起，形成的具有FPC特性与PCB特性的线路板。

扩展资料：

电路板的分类：

1、单面板

在最基本的PCB上，零件集中在其中一面，导线则集中在另一面上。因为导线只出现在其中一面，所以就称这种PCB叫作单面线路板。单面板通常制作简单，造价低，但是缺点是无法应用于太复杂的产品上。

2、双面板

是单面板的延伸，当单层布线不能满足电子产品的需要时，就要使用双面板了。双面都有覆铜有走线，并且可以通过过孔来导通两层之间的线路，使之形成所需要的网络连接。

3、多层板

是指具有三层以上的导电图形层与其间的绝缘材料以相隔层压而成，且其间导电图形按要求互连的印制板。多层线路板是电子信息技术向高速度、多功能、大容量、小体积、薄型化、轻量化方向发展的产物。

参考资料来源：百度百科—电路板

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24G 高频PCB板设时，要注意的事项：
1、如何选择PCB板材？
选择PCB板材必须在满足设计需求和可量产性及成本中间取得平衡点。设计需求包含电气和机构这两部分。通常在设计非常高速的PCB板子(大于GHz的频率)时这材质问题会比较重要。例如，现在常用的FR-4材质，在几个GHz的频率时的介质损(dielectric loss)会对信号衰减有很大的影响，可能就不合用。就电气而言，要注意介电常数(dielectric constant)和介质损在所设计的频率是否合用。
2、如何避免高频干扰？
避免高频干扰的基本思路是尽量降低高频信号电磁场的干扰，也就是所谓的串扰(Crosstalk)。可用拉大高速信号和模拟信号之间的距离，或加ground guard/shunt traces在模拟信号旁边。还要注意数字地对模拟地的噪声干扰。
3、在高速设计中，如何解决信号的完整性问题？
信号完整性基本上是阻抗匹配的问题。而影响阻抗匹配的因素有信号源的架构和输出阻抗(output impedance)，走线的特性阻抗，负载端的特性，走线的拓朴(topology)架构等。解决的方式是靠端接(termination)与调整走线的拓朴。
4、差分布线方式是如何实现的？
差分对的布线有两点要注意，一是两条线的长度要尽量一样长，另一是两线的间距(此间距由差分阻抗决定)要一直保持不变，也就是要保持平行。平行的方式有两种，一为两条线走在同一走线层(side-by-side)，一为两条线走在上下相邻两层(over-under)。一般以前者side-by-side实现的方式较多。
5、对于只有一个输出端的时钟信号线，如何实现差分布线？
要用差分布线一定是信号源和接收端也都是差分信号才有意义。所以对只有一个输出端的时钟信号是无法使用差分布线的。
6、接收端差分线对之间可否加一匹配电阻？
接收端差分线对间的匹配电阻通常会加, 其值应等于差分阻抗的值。这样信号品质会好些。
7、为何差分对的布线要靠近且平行？
对差分对的布线方式应该要适当的靠近且平行。所谓适当的靠近是因为这间距会影响到差分阻抗(differential impedance)的值, 此值是设计差分对的重要参数。需要平行也是因为要保持差分阻抗的一致性。若两线忽远忽近, 差分阻抗就会不一致, 就会影响信号完整性(signal integrity)及时间延迟(timing delay)。
8、如何处理实际布线中的一些理论冲突的问题
1 基本上, 将模/数地分割隔离是对的。 要注意的是信号走线尽量不要跨过有分割的地方(moat), 还有不要让电源和信号的回流电流路径(returning current path)变太大。
2 晶振是模拟的正反馈振荡电路, 要有稳定的振荡信号, 必须满足loop gain与phase的规范, 而这模拟信号的振荡规范很容易受到干扰, 即使加ground guard traces可能也无法完全隔离干扰。 而且离的太远, 地平面上的噪声也会影响正反馈振荡电路。 所以, 一定要将晶振和芯片的距离进可能靠近。
3 确实高速布线与EMI的要求有很多冲突。 但基本原则是因EMI所加的电阻电容或ferrite bead, 不能造成信号的一些电气特性不符合规范。 所以, 最好先用安排走线和PCB叠层的技巧来解决或减少EMI的问题, 如高速信号走内层。 最后才用电阻电容或ferrite bead的方式, 以降低对信号的伤害。